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배치를 위한 효율적인 Elmore Delay 오차 보상방법

Title
배치를 위한 효율적인 Elmore Delay 오차 보상방법
Other Titles
Efficient Method for Elmore Delay Error Correction for Placement
Author
신현철
Keywords
VLSI 디자인; 배치; 앨모어 딜레이; 지연시간 계산; VLSI design; placement; Elmore delay; delay estimation
Issue Date
2002-06
Publisher
한국정보과학회
Citation
정보과학회논문지 : 시스템 및 이론, v. 29, no. 5·6, page. 354-360
Abstract
지연시간 계산은 지연시간을 고려한 배치 단계에서 백만 번 이상도 수행되므로 효과적이면서 간단해야 한다. 본 논문에서는 계산은 매우 빠르고 간단하지만 수 백%의 오차를 가질 수 있는 Elmore delay를 개선하기 위해 Elmore delay와 SPICE 결과의 비율을 보상값으로 이용하는 방법을 제안한다. 제안한 새로운 방법은 resistance shielding effects를 고려하여 실험적으로 지연시간을 보상하여 그 오차를 크게 줄이며, 계산 복잡도는 Elmore delay와 같은 정도로 간단하다. Elmore delay가 31.6 ~ 145.2% 오차를 갖는 RC 트리에 대하여 실험한 결과, 보상된 delay의 오차는 2.5 ~ 22.7%로 크게 줄었다. Delay estimation must be simple and efficient, since millions or more delay calculations may be required during a timing-driven placement stage. We have developed a new Modified Elmore delay estimation method, which is significantly more accurate than the original Elmore delay by considering resistance shielding effects, but has the same order of complexity with that of Elmore delay. Experimental results show that the suggested technique can significantly reduce the error in estimated delay, from 31.6 ~ 145.2% to 2.5 ~ 22.7%.
URI
http://www.dbpia.co.kr/journal/articleDetail?nodeId=NODE00614623https://repository.hanyang.ac.kr/handle/20.500.11754/157038
ISSN
1229-683X
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