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Issue DateTitleAuthor(s)
2008-04효율적인 SoC 테스트를 위한 온/오프-칩 버스 브리지 활용기술에 대한 연구박성주
2008-05Low-cost scan test for IEEE-1500-Based SoC박성주
2008-11A Design-for-Debug (DfD) for NoC-based SoC debugging via NoC박성주
2009-01Highly Compact Interconnect Test Patterns for Crosstalk and Static Faults박성주
2009-02스캔 기반 사이드 채널 공격에 대한 새로운 AES 코아 키 보호 기술박성주
2009-03An Efficient SoC Test Technique by Reusing On/Off-Chip Bus Bridge박성주
2009-11Parallel test method for NoC-based SoCs박성주
2010-02스캔 설계된 AES 코아의 효과적인 비밀 키 보호 기술박성주
2010-07A Scan Cell Design for Scan-Based Debugging of an SoC With Multiple Clock Domains박성주
2010-07On-Chip Support for NoC-Based SoC Debugging박성주
2011-02AMBA 기반 SoC의 병렬 코어 테스트를 위한효과적인 테스트 설계 기술박성주
2011-04Performance Improvement by Logic Sharing on Using Unused Spare Columns for Memory EC박성주
2011-04Multiple cell upsets tolerant content-addressable memory박성주
2011-08Redundancy TSV 연결 테스트를 위한 래퍼셀 설계박성주
2011-11Efficient use of unused spare columns to improve memory error correcting rate박성주
2012-09Efficient Use of Unused Spare Columns for Reducing Memory Miscorrections박성주
2012-09An Efficient Technique to Protect AES Secret Key from Scan Test Channel Attacks박성주
2012-12Characterizing the Capacitive Crosstalk in SRAM Cells Using Negative Bit-Line Voltage Stress박성주
2013-01TSV 기반 3D IC Pre/Post Bond 테스트를 위한IEEE 1500 래퍼 설계기술박성주
2013-07테스트 비용 절감을 위한 스캔체인 기반의 저전력 테스트 패턴 압축기술박성주

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