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단일 코어 셀 확장을 이용한 다중포트 메모리 컴파일러

Title
단일 코어 셀 확장을 이용한 다중포트 메모리 컴파일러
Other Titles
Multiport Memory Compiler using Single Core Cell Expansion
Author
신현철
Issue Date
2001-04
Publisher
한국정보과학회
Citation
정보과학회논문지 : 시스템 및 이론, v. 28, no. 3·4, page. 196-203
Abstract
본 논문에서는 빠른 시간 내에 설계자의 요구사양을 만족하는 메모리를 자동으로 합성해주는 새로운 멀티포트 메모리 컴파일러를 제안하였다. 제안한 컴파일러의 장점은 하나의 메모리 코어 셀을 규칙적으로 배치, 확장하여 메모리를 합성하고, 동시에 합성된 메모리내의 임계경로만을 추출하여 빠르게 검증할 수 있다는 것이다. 또한, 레이아웃 상에서의 전원선 폭 조절, 전원선 공유 등의 기법으로 메모리의 성능을 향상시킬 수 있도록 하였다. 본 컴파일러를 사용하여 0.25 μm CMOS 1-poly, 2-metal 공정에서 최대 8개의 쓰기 포트, 16개의 읽기 포트, 64워드, 256비트 사이의 여러 가지 멀티포트 메모리를 자동 합성하였다. 합성 결과 메모리의 성능 및 면적 면에서 만족할 만한 결과를 얻었으며, 레이아웃 전체에서의 시뮬레이션 시간보다 10배정도 빠른 시간 내에 동작을 정확히 검증하였다. In this paper, we propose a new memory compiler which can automatically generate multi-port memories in a short design time while satisfying the user constraints. Advantages of the compiler are to synthesize memories by placing and expanding a core cell, according to the number of ports and word length, and to verify the performance by extracting and analyzing critical paths. The performance of the memory is optimized by adjusting wire-width and by sharing power lines. Using the memory compiler, several multi-port memories including a memory of 8 write ports, 16 read ports, 64 words, and 256 bits have been synthesized for a 0.25 μm CMOS 1-poly, 2-metal process. Experimental results show that the performance and area of the generated memory is satisfactory, and the simulation time of the extracted layout for critical paths is reduced significantly by eliminating the non-critical paths during circuit extraction.
URI
https://www.dbpia.co.kr/journal/articleDetail?nodeId=NODE00609895https://repository.hanyang.ac.kr/handle/20.500.11754/158567
ISSN
1229-683X
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